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關于網絡表問題望各位高手給予解答!

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1#
發表于 2004-5-24 10:46:47 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
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我畫了一個電路圖(暫命名為A),畫好了經檢查各元件的封裝正常,但進行ERC檢查時Project菜單下的compile all projects按鈕呈灰色,無法操作。一番折騰后雖然compile all projects按鈕可以用了,但被檢查的是電腦內儲存著以前曾被打開過的文件,索性將Protel DXP程序關閉,然后再打開A圖進行ERC檢查(之前并未進行其它操作)。可依舊出現上述問題,為了驗證自己畫的圖紙是否有誤?我重新畫了一張圖紙上只有兩個相并聯的電阻,可還是無法進行ERC檢查。請問那是怎么回事?生成網絡表除了上述兩點還要進行其它設置嗎?網絡表生成之后設計PCB又怎樣將其導入呢?又應該注意此什么呢?
望高手能給予解答!
非常感謝!
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2#
 樓主| 發表于 2004-5-24 16:19:35 | 只看該作者
怎么還是沒有人為我解答呢?我都急死了。
請各位指點一下!萬分感謝!
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3#
發表于 2004-5-25 11:46:36 | 只看該作者
我在你的另一個帖子上寫了一點我的看法。你去看看吧!
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